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【27届校招】综合实现工程师 上海 正式 研发 - 电子 / 半导体 职位描述 1、逻辑综合与优化： 使用Synopsys DC/FC或Cadence Genus等工具，进行模块级/芯片级综合，制定并实施综合策略，优化时序、面积和功耗。2、静态时序分析（STA）： 使用PrimeTime等工具，进行全芯片的签核级时序验证，分析建立时间、保持时间，并能熟练处理时钟域交叉（CDC）问题。3、形式验证： 使用Formality或Conformal等工具，完成RTL与门级网表之间的逻辑等效性验证（LEC），确保功能一致性。4、设计约束（SDC）编写与管理： 制定准确、完备的时序约束文件，指导综合与STA流程。5、与前后端团队协作： 与前端设计工程师/DFT工程师紧密合作，理解设计意图并提出可综合性建议；与后端物理设计工程师协作，解决时序收敛等关键问题。 职位要求 1、学历专业： 微电子、集成电路、电子工程、计算机科学等相关专业，硕士或博士毕业生。2、知识基础： 扎实的数字电路基础，深入理解CMOS原理、时序分析理论（建立/保持时间、时钟抖动、偏斜等）和低功耗设计方法学。3、工具与语言：-熟悉Verilog或SystemVerilog等数字电路设计语言。-熟悉Linux操作环境及基本的脚本语言（Tcl/Perl/Python/Shell之一）。4、流程理解： 了解数字IC前端到后端的完整设计流程，特别是中端的关键步骤。5、能力素质： 具备出色的分析问题、解决问题的能力，严谨细致，具备良好的团队沟通与协作精神。优先条件（符合以下条件者优先考虑）：1、有基于业界主流工艺节点（如28nm, 12nm, 7nm等）的芯片项目（课设、竞赛、实习）中端或前端实践经验。2、对UPF等低功耗设计流程有实际项目经验。3、熟悉AMBA总线协议（AHB、APB、AXI）或常见接口协议（如DDR、PCIe、USB）。4、在形式验证、逻辑综合或STA方面有深入的研究或项目经验。 投递...
Company Description Do you want beneficial technologies being shaped by your ideas? Whether in the areas of mobility solutions, consumer goods, industrial technology or energy and building technology - with us, you will have the chance
DFT Application Engineer Manager Location: Shanghai We Are: Synopsys is the leader in engineering solutions from silicon to systems, enabling customers to rapidly innovate AI-powered products. We deliver industry-leading silicon design, IP, simulation and analysis solutions, and
芯片模拟设计工程师 西安、上海、深圳 校招 正式 硬件研发类 2027届校园招聘计划 职位描述 1.负责模拟/混合信号芯片的电路设计，包括ADC、DAC、PLL、电源管理等模块的架构设计与电路实现；2.进行电路仿真与验证，确保设计满足功能、性能及可靠性指标；3.协同版图工程师完成物理设计，参与版图审查与优化；4.制定芯片测试方案，支持量产测试与良率提升；5.跟踪先进工艺节点的技术发展，推动设计方法学创新。 职位要求 1、硕士研究生及以上学历，专业背景包括微电子、集成电路设计、电子工程等相关领域。2、具有模拟/混合信号电路设计经验，熟悉Cadence、Synopsys等EDA工具。3、具备CMOS工艺基础知识，了解器件物理与工艺流程。4、掌握SPICE仿真、Monte Carlo分析等电路验证方法。5、具有芯片设计实习或流片经验者优先。6、有良好的沟通能力、分析问题能力以及团队合作意识。 投递...
芯片DFT设计工程师 西安、上海 校招 正式 硬件研发类 2027届校园招聘计划 职位描述 1.完成SOC芯片DFT设计工作，Bist，Jtag，Scan，ATPG等；2.完成DFT方案，设计，仿真，时序分析等；3.负责芯片投片前各项signoff检查；4.参与先进工艺的导入，诊断良率问题，催熟工艺达成量产目标。 职位要求 1.微电子.计算机等相关专业，硕士及以上学历；2.具有扎实的数字电路理论基础，熟悉数字电路IC设计流程；3.掌握Verilog语言，静态时序分析概念清晰；4.熟悉DFT相关EDA工具（如Mentor/Synopsys）；5.熟悉脚本语言，tcl，perl，或python；6.具有良好的沟通与组织协调能力。 投递...
SOC设计工程师 西安、上海 校招 正式 硬件研发类 2027届校园招聘计划 职位描述 1、参与SOC系统的设计、分析和开发工作；2、参与SOC顶层或子模块的设计工作，根据需求制定各模块的设计规格和详细设计方案；3、完成RTL代码以及质量检查（lint,CDC，预综合等）预综合并输出timingspec；4、结合产品实际需求，在chiplet片间互联、处理器微架构等前沿技术领域进行探索和分析；5、跟踪和研究各个领域的技术进展及业界新技术。 职位要求 1、微电子、集成电路、电子信息、通信工程、计算机等相关专业；2、符合如下任一条件：a.掌握Verilog语言并具备一定的coding能力，一定程度上掌握SOC的设计流程，并熟悉Synopsys/Cadence/Mentor等公司的EDA工具优先；b.了解芯片设计基本知识，如代码规范、工作环境和工具、典型电路(异步、状态机、FIFO、时钟复位、memory、缓存管理等)优先；c.熟悉CHI.AXI/AHB/APB等AMBA或其它总线协议优先；3、积极主动，认真严谨，有良好的沟通能力和团队合作能力。 投递...
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Locations: Shanghai, China Categories: Engineering Req ID: 91781 ADVANCE YOUR CAREER. ADVANCE THE WORLD. At AMD, we believe technology has the power to solve the world’s most important challenges. From advancing healthcare and scientific discovery to
General Information Job Title ZeBu Application Engineer Job ID 18605 Country China City Shanghai Date Posted 02-Sep-2026 Job Category Engineering Job Subcategory Applications Engineering Hire Type Employee Remote Eligible No Descriptions & Requirements Job Description and
ZeBu Application Engineer Location: SH Synopsys is uniquely positioned to offer the most complete verification solution in market today. ZeBu is the emulation platform of Synopsys verification flow, it’s the industry’s performance & capacity in Emulation. As a
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